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PDF ZL50404 Data sheet ( Hoja de datos )

Número de pieza ZL50404
Descripción Lightly Managed/Unmanaged 5-Port 10/100 M Ethernet Switch
Fabricantes Zarlink Semiconductor　
Logotipo Zarlink Semiconductor Logotipo



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ZL50404
Lightly Managed/Unmanaged
5-Port 10/100M Ethernet Switch
Data Sheet
Features
• Integrated Single-Chip 10/100 Ethernet Switch
• Four 10/100 Mbps auto-negotiating Fast
Ethernet (FE) ports with RMII, MII, GPSI,
Reverse MII & Reverse GPSI interface options
• One 10/100 Mbps auto-negotiating port with
MII interface option, that can be used as a
WAN uplink or as a 9th port
• Embedded 2 Mbits (256 KBytes) internal memory
• supports up to 4 K byte frames
www.D•ataLS2hesewt4itUc.hcionmg
• MAC address self learning, up to 4 K MAC
addresses using internal table
• Supports the following spanning standards
- IEEE 802.1D spanning tree
- IEEE 802.1w rapid spanning tree
• Supports Ethernet multicasting and
broadcasting and flooding control
• VLAN Support
• Supports port-based VLAN
• CPU access supports the following interface
options:
• Serial interface in lightly managed mode, or in
unmanaged mode with optional I2C EEPROM
interface
August 2004
Ordering Information
ZL50404GDC
208 Pin LBGΑ
-40°C to +85°C
• Failover Features
• Rapid link failure detection using
hardware-generated heartbeat packets
• link failover in less than 50 ms
• Rate Control (both ingress and egress)
• Bandwidth rationing, Bandwidth on demand,
SLA (Service Level Agreement)
• Smooth out traffic to uplink port
• Ingress Rate Control
- Back pressure
- Flow Control
- WRED (Weighted Random Early Discard)
• Egress Rate Control
• Down to 16 kbps Rate Control granularity
C
P Serial
U
EEPROM I2C
ZL50404
5-Port 10/100M
Ethernet Switch
MII
RMII / MII / GPSI
10/100
PHY
Quad
10/100
PHY
Figure 1 - System Block Diagram
1
Zarlink Semiconductor Inc.
Zarlink, ZL and the Zarlink Semiconductor logo are trademarks of Zarlink Semiconductor Inc.
Copyright 2003-2004, Zarlink Semiconductor Inc. All Rights Reserved.

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ZL50404 pdf
ZL50404
Data Sheet
Table of Contents
6.1 Data Forwarding Summary . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 33
6.2 Frame Engine Details . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 33
6.2.1 FCB Manager. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 33
6.2.2 Rx Interface . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 33
6.2.3 RxDMA. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 34
6.2.4 TxQ Manager . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 34
6.2.5 Port Control . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 34
6.2.6 TxDMA . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 34
7.0 Quality of Service and Flow Control . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 34
7.1 Model . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 34
7.2 Two QoS Configurations . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 35
7.2.1 Strict Priority. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 36
7.2.2 Weighted Fair Queuing . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 36
www.DataS7h.3eeWt4RU.EcoDmDrop Threshold Management Support . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 36
7.4 Shaper . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 36
7.5 Rate Control . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 37
7.6 Buffer Management . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 38
7.6.1 Dropping When Buffers Are Scarce . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 39
7.7 Flow Control Basics. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 39
7.7.1 Unicast Flow Control . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 39
7.7.2 Multicast Flow Control . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 39
7.8 Mapping to IETF Diffserv Classes . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 39
7.9 Failover Backplane Feature. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 40
8.0 Port Trunking . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 41
8.1 Features and Restrictions . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 41
8.2 Unicast Packet Forwarding . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 41
8.3 Multicast Packet Forwarding . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 41
9.0 Traffic Mirroring . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 41
9.1 Mirroring Features . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 41
9.2 Using port mirroring for loop back . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 42
10.0 GPSI (7WS) Interface . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 42
10.1 GPSI connection . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 42
11.0 Clocks . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 43
11.1 Clock Requirements . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 43
11.1.1 System Clock (SCLK) speed requirement . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 43
11.1.2 RMAC Reference Clock (M_CLK) speed requirement. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 43
11.1.3 MMAC Reference Clock (REF_CLK) speed requirement . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 43
11.1.4 JTAG Test Clock (TCK) speed requirements. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 43
11.2 Clock Generation. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 43
11.2.1 MDC . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 43
11.2.2 SCL . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 43
11.2.3 Ethernet Interface Clocks. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 43
12.0 Hardware Statistics Counters . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 44
12.1 Hardware Statistics Counters List . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 44
12.2 IEEE 802.3 HUB Management (RFC 1516) . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 46
12.2.1 Event Counters . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 46
12.2.1.1 ReadableOctet . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 46
12.2.1.2 ReadableFrame . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 46
12.2.1.3 FCSErrors. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 46
12.2.1.4 AlignmentErrors . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 46
12.2.1.5 FrameTooLongs . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 47
5
Zarlink Semiconductor Inc.

5 Page





ZL50404 arduino
ZL50404
1.0 BGA and Ball Signal Descriptions
1.1 BGA Views (Top-View)
Data Sheet
1 2 3 4 5 6 7 8 9 10 11 12 13 14 15 16
A SCLK
DATAI
N
DATAO
UT
STRO
BE
RSVD
RSVD
RSVD
RSVD
B P_INT
#
SDA
SCL
RSVD
RSVD
RSVD
RSVD
RSVD
C
RESET
TSTO
OUT#
UT1
D RESIN TSTO
# UT0
TSTO
UT3
TSTO
UT2
TSTO
UT5
TSTO
UT4
TSTO
UT6
3.3V
TSTO
UT7
SCAN_
EN
TSTO
UT9
TSTO
UT8
TSTO
UT11
TSTO
UT10
E M2_C
OL
M0_C
OL
www.DaFtaShMe_MeDt4U.cM_oMmDI
CO
M1_C
OL
M0_RX
D2
3.3V
M0_RX
D3
G
M0_RX
M0_RX
M0_RX
M0_TX
D0 D1 CK D3
GND
GND
H M0_C
RS
M0_TX
EN
M0_TX
D2
1.8V
GND
GND
J
M0_TX
M0_TX
M0_TX
M1_RX
D0 D1 CK D3
GND
GND
K
M1_RX
M1_RX
M1_RX
M1_RX
D0 D1 D2 CK
GND
GND
L M1_C
RS
M1_TX
EN
M1_TX
D2
M1_TX
D3
M M1_TX M1_TX M1_TX 3.3V
D0 D1 CK
N
M2_RX
M2_TX
M2_TX
M3_RX
3.3V
D3 CK D3 D3
M3_TX
D3
1.8V
RSVD
P
M2_RX
M2_RX
M2_TX
M3_RX
M3_RX
M3_TX
M3_C
D2 CK D2 D2 CK D2 OL
RSVD
R
M2_RX
M2_TX
M2_TX
M3_RX
M3_TX
M3_TX
M_CLK RSVD
D1 EN D1 D1 EN D1
T
M2_RX
M2_C
D0 RS
M2_TX
D0
M3_RX
D0
M3_C
RS
M3_TX
D0
M3_TX
CK
RSVD
12345678
RSVD
RSVD
TSTO
UT12
1.8V
GND
GND
GND
GND
RSVD
RSVD
RSVD
RSVD
9
RSVD
RSVD
TSTO
UT14
TSTO
UT13
GND
GND
GND
GND
RSVD
RSVD
RSVD
RSVD
10
RSVD
RSVD
TSTO
UT15
TDO
RSVD
RSVD
RSVD
RSVD
11
RSVD
RSVD
REF_C
LK
TCK
RSVD
TMS
TRST#
TDI
RSVD
3.3V
RSVD
RSVD
3.3V
RSVD
M9_M
TXCLK
RSVD
M9_C
RS
M9_RX
DV
RSVD
M9_TX
EN
M9_RX
CK
M9_C
OL
RSVD
RSVD
A
B
C
D
E
M9_RX
D2
M9_RX
D0
1.8V
RSVD
M9_RX
D3
M9_RX
D1
RSVD
RSVD
RSVD
M9_TX
D2
M9_TX
D0
RSVD
RSVD
M9_TX
D3
M9_TX
D1
RSVD
F
G
H
J
RSVD
RSVD
RSVD
RSVD
K
RSVD
RSVD
RSVD
RSVD
L
3.3V
RSVD
RSVD
RSVD
M
RSVD
RSVD
RSVD
RSVD
RSVD
N
RSVD
RSVD
RSVD
RSVD
RSVD
P
RSVD
RSVD
RSVD
RSVD
RSVD
R
RSVD
RSVD
RSVD
RSVD
RSVD
T
12 13 14 15 16
1.2 Power and Ground Distribution
G7-10, H7-10, J7-10, K7-10
D5, D12, E4, E13, M4, M13,
N5
D9, H4, H13, N7
GND
3.3V
1.8V
VSS
VCC
VDD
Ground
I/O Power
Core Power
11
Zarlink Semiconductor Inc.

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PDF Descargar[ Datasheet ZL50404.PDF ]




Hoja de datos destacado

Número de piezaDescripciónFabricantes
ZL50400Lightly Managed/Unmanaged 9-Port 10/100 M Ethernet SwitchZarlink Semiconductor
Zarlink Semiconductor
ZL50402Managed 2 - Port 10/100 M + 1 - Port 10/100/1000 M Ethernet SwitchZarlink Semiconductor
Zarlink Semiconductor
ZL50404Lightly Managed/Unmanaged 5-Port 10/100 M Ethernet SwitchZarlink Semiconductor
Zarlink Semiconductor
ZL50405Managed5-Port 10/100 M Ethernet SwitchZarlink Semiconductor
Zarlink Semiconductor

Número de piezaDescripciónFabricantes
SLA6805M

High Voltage 3 phase Motor Driver IC.

 Sanken
Sanken
SDC1742

12- and 14-Bit Hybrid Synchro / Resolver-to-Digital Converters.

 Analog Devices
Analog Devices


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