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PDF HYE18P16161AC Data sheet ( Hoja de datos )

Número de pieza HYE18P16161AC
Descripción 16M Asynchronous/Page CellularRAM
Fabricantes Infineon　
Logotipo Infineon Logotipo



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Data Sheet, V2.0, December 2003
HYE18P16161AC-70/L70
HYE18P16161AC-85/L85
16M Asynchronous/Page CellularRAM
CellularRAM
Memory Products
Never stop thinking.

1 page




HYE18P16161AC pdf
HYE18P16161AC(-/L)70/85
16M Asynch/Page CellularRAM
1
1.1
1.2
1.3
1.4
1.5
1.6
2
2.1
2.2
2.3
2.3.1
2.3.2
2.3.3
2.3.4
2.3.5
2.4
2.4.1
2.5
2.6
2.7
3
3.1
3.2
3.3
3.4
4
5
5.1
6
Overview . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 8
Features . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 8
General Description . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 9
HYE18P16161AC(-/L)70/85 Ball Configuration . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 10
HYE18P16161AC(-/L)70/85 Ball Definition and Description . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 11
Functional Block Diagram . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 12
Commands . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 13
Functional Description . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 14
Power-Up and Initialization . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 14
Access To The Control Register Map . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 15
Refresh Control Register . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 16
Partial Array Self Refresh (PASR) . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 17
Deep Power Down Mode . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 18
Temperature Compensated Self Refresh (TCSR) . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 18
Power Saving Potential in Standby When Applying PASR, TCSR or DPD . . . . . . . . . . . . . . . . . . . 18
Page Mode Enable/Disable . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 19
Asynchronous Read . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 20
Page Read Mode . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 21
Asynchronous Write . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 23
Deep Power Down Mode Entry/ Exit . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 26
General AC Input/Output Reference Waveform . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 26
Electrical Characteristics . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 27
Absolute Maximum Ratings . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 27
Recommended Power & DC Operation Ratings . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 27
Output Test Conditions . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 28
Pin Capacitances . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 28
Package Outlines . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 29
Appendix A: Low-Frequency Mode . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 30
Asynchronous Access . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 30
Appendix B: S/W Register Entry Mode (“4-cycle method”) . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 31
Data Sheet
5 V2.0, 2003-12-16

5 Page





HYE18P16161AC arduino
HYE18P16161AC(-/L)70/85
16M Asynch/Page CellularRAM
Overview
1.4 HYE18P16161AC(-/L)70/85 Ball Definition and Description
Table 2 Ball Description - HYE18P16161AC(-/L)70/85
Ball Type Detailed Function
CS1 Input Chip Select
CS1 enables the command decoder when low and disables it when high. When the
command decoder is disabled new commands are ignored, addresses are don’t care and
outputs are forced to high-Z. Internal operations, however, continue. For the details
please refer to the command tables in Chapter 1.6.
OE Input Output Enable
OE controls DQ output driver. OE low drives DQ, OE high sets DQ to high-Z.
WE Input Write Enable
WE set to low while CS is low initiates a write command.
UB, LB
Input
Upper/Lower Byte Enable
UB enables the upper byte DQ15-8 (resp. LB DQ7 … 0) during read/write operations.
UB (LB) deassertion prevents the upper (lower) byte from being driven during read or
being written.
ZZ
Input
Deep Power Down Enable/ Set Control Register
Strapping ZZ to low for more than 10µs the device is put to deep power down mode. If a write
access is initiated instantly (<500ns) after ZZ has been asserted to low access to the refresh
configuration register is given. By applying the SET CONTROL REGISTER (SCR) command
(see Table 3) the address bus is then loaded into the refresh control register.
A <19:0> Input
Address Inputs
During a Control Register Set operation, the address inputs define the register settings.
DQ <15:0> I/O
Data Input/Output
The DQ signals 0 to 15 form the 16-bit data bus.
1 × VDD
1 × VSS
1 × VDDQ
1 × VSSQ
2 × NC
Power
Supply
Power
Supply
–
Power Supply, Core
Power and Ground for the internal logic.
Power Supply, I/O Buffer
Isolated Power and Ground for the output buffers to provide improved noise immunity.
No Connect
Please do not connect. Reserved for future use, i.e. H6: A20, E3: A21, see ballout in
Figure 2 on Page 10.
Data Sheet
11 V2.0, 2003-12-16

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Hoja de datos destacado

Número de piezaDescripciónFabricantes
HYE18P16161AC16M Asynchronous/Page CellularRAMInfineon
Infineon
HYE18P16161AC-60MEMORY SPECTRUMInfineon
Infineon
HYE18P16161AC-7016M Asynchronous/Page CellularRAMInfineon
Infineon
HYE18P16161AC-8516M Asynchronous/Page CellularRAMInfineon
Infineon

Número de piezaDescripciónFabricantes
SLA6805M

High Voltage 3 phase Motor Driver IC.

 Sanken
Sanken
SDC1742

12- and 14-Bit Hybrid Synchro / Resolver-to-Digital Converters.

 Analog Devices
Analog Devices


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